在時(shí)鐘與射頻電路設(shè)計(jì)中，石英晶體及晶體濾波器的PCB布局直接關(guān)系到系統(tǒng)的穩(wěn)定性與性能表現(xiàn)?！颁伒剡€是挖空”應(yīng)基于器件的電氣本質(zhì)進(jìn)行判斷：

- 挖空：對(duì)于高阻抗、參與起振的關(guān)鍵節(jié)點(diǎn)，應(yīng)優(yōu)先減少PCB寄生電容的影響；

- 鋪地：對(duì)于低阻抗、已在器件內(nèi)部完成振蕩或需要良好電磁屏蔽的器件，應(yīng)優(yōu)先保證穩(wěn)定、連續(xù)的接地參考。

推薦做法：

- 晶體焊盤正下方保持挖空；  

- 晶體本體下避免大面積鋪地；  

- 在晶體外圍設(shè)置接地護(hù)環(huán)，抑制外界干擾；

- 晶體走線盡量短、對(duì)稱、避免跨分割。

在部分低頻應(yīng)用或驅(qū)動(dòng)能力較強(qiáng)的系統(tǒng)中，即使未完全挖空，電路仍可能工作。但從頻率精度、溫漂和批量一致性的角度看，“挖空”仍是更穩(wěn)妥的選擇。

有源晶振在封裝內(nèi)部已集成晶體、振蕩、放大和緩沖電路。此時(shí)，晶體振蕩已經(jīng)在器件內(nèi)部完成，PCB上輸出的是驅(qū)動(dòng)能力較強(qiáng)的時(shí)鐘信號(hào)，而不再是高阻抗節(jié)點(diǎn)。因此，這類器件對(duì)PCB寄生電容并不敏感，反而更依賴穩(wěn)定、低阻抗的地參考。

推薦做法：

- 器件本體下方鋪設(shè)連續(xù)接地銅皮；

- 確保地回路短且完整；

- 電源去耦電容緊貼器件引腳。  

對(duì)于TCXO、VCXO和OCXO等高穩(wěn)定度器件，內(nèi)部包含溫補(bǔ)、調(diào)諧或恒溫控制等模擬模塊，地平面的連續(xù)性直接關(guān)系到相位噪聲和頻率穩(wěn)定性，因此行業(yè)中通常建議采用完整、連續(xù)的接地設(shè)計(jì)。

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